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嵌入式OS-Linux

Linux應用開發班
嵌入式Linux系統開發班

嵌入式Linux驅動開發班
Linux網絡工程及系統管理
QT應用開發培訓班
Linux內核剖析高級培訓班
嵌入式Linux實時系統與內核開發班
RT Linux開發高級班
嵌入式Linux/MiniGUI高級培訓班
Linux高手直通車-LPI全球認證課程
嵌入式Linux高級編程及網絡核心技術
Linux驅動、系統、應用全能班

嵌入式CPU--ARM

ARM開發培訓班

CortexM3+uC/OS培訓班

Cortex-M0開發培訓班

eCos驅動移植培訓

MIPS高級開發班

BlackFin培訓(基于uClinux平臺)

Arduino開發實戰培訓班

嵌入式OS--WinCE

WinCE應用開發培訓班

WinCE系統定制與驅動班

Windows CE項目案例培訓班

單片機培訓

單片機系統開發初級和中級班

嵌入式硬件設計

高速嵌入式系統硬件設計班

Allegro Cadence PCB設計初級和中級班

Allegro Cadence PCB設計高級班

PCB Layout培訓-線路板設計全能班

Allegro Cadence PCB Layout高級班

Cadence SI 仿真分析工具專題班

信號完整性專題班

EMI的設計原理與偵錯防制技術高階培訓班

Altium Designer Layout高速硬件設計

嵌入式OS--VxWorks

PowerPC嵌入式系統/編譯器優化


PLC編程/變頻器/數控/人機界面

PLC編程系列培訓課程表
變頻器系列培訓課程表

人機界面、數控系列培訓課程表

開發語言/數據庫/軟硬件測試

Java/.NET/C#/SQL全能培訓班

Microsoft.NET Framework培訓

Windows內核修煉和內核安全

3G手機軟件測試、硬件測試

芯片設計/大規模集成電路VLSI

手機電路原理、維修與調試

芯片設計/大規模集成電路VLSI系列

云計算、物聯網

開源操作系統Tigy OS開發

汽車電子培訓班

汽車電子總線協議系列一--CAN/LIN/FlexRay總線協議

汽車電子總線協議系列二--SAE J1939/ODX/CANopen/MOST/OSEK/VDX總線協議

汽車電子測試與試驗系列一--CAN/LIN網絡測試、黑白盒測試

車載診斷系統(OBD協議)培訓

汽車電子測試與試驗系列二--HIL/EOL、系統集成測試

汽車電子工具使用系列一---CANoe、QAC的高級應用

汽車電子工具使用系列二---PREEvision、CANalyzer、CANape的高級應用

檢測/傳感器/大、小型機及其他

測量電子電路設計
(濾波器和模擬OP放大器電路)

培訓報名

培訓報名
培訓課程
工作推薦
嵌入式合作(項目承接)


WEB在線客服

	QQ客服一
	QQ客服二


合作伙伴與授權機構

現代化的多媒體教室

公益培訓

第6期曙海大型嵌入式公益培訓
“嵌入式DSP宣講會”

第5期曙海大型嵌入式公益培訓
“嵌入式FPGA宣講會”

第4期曙海大型嵌入式公益培訓
“嵌入式DSP6000宣講會”

第3期曙海大型嵌入式公益培訓
“嵌入式Linux宣講會”

第2期曙海大型嵌入式公益培訓
“嵌入式Wince宣講會”

第1期曙海大型嵌入式公益培訓
“嵌入式Linux宣講會”

曙海動態

2009年“寒假培訓系列課程”
開始招生[2008-12-31]

曙海嵌入式學院隆重推出“寒
假培訓系列課程”[2007-12-16]

慶祝曙海創立5周年，部分課
程9折回饋學員[2006-03-12]

為普及嵌入式課程，學生
報名享受優惠[2005-08-03]

曙海教育嵌入式培訓課程全面
升級,啟用2.0版[2004-06-14]

曙海教育成為Altera公司
全球合作培訓機構[2002-10-07]

020321屆Linux驅動開發班
學生圓滿畢業[2002-04-25]

上海計算機技術協會頒發給曙海
高新技術科技證書[2001-05-19]

Xilinx專業培訓課程

培訓結束后頒發工程師培訓證書。

班級規模及環境

為了保證培訓效果，增加互動環節，我們堅持小班授課，每期報名人數限5人。人手一機，全程實踐。

上課時間和地點

上課地點：【【上海】：同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院【北京分部】：北京中山學院/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領館區1號（中和大道）
　　本課程每期班限額5名，報滿即停止報名，請提前在線或電話預約

課時

        ◆課時：一個月
        ◆團體報名優惠措施：請咨詢客服
        ◆外地學員：代理安排食宿（需提前預定）
        ☆合格學員免費頒發相關資格證書，提升您的職業資質
        作為最早專注于嵌入式培訓的專業機構，曙海嵌入式學院提供的證書得到本行業的廣泛認
        可，學員的能力得到大家的認同。
        ☆合格學員免費推薦工作
        ★實驗設備請點擊這兒查看★

質量保障

        1、培訓過程中，如有部分內容理解不透或消化不好，可免費在下期培訓班中重聽；
        2、培訓結束后,培訓老師留給學員手機和Email,免費提供半年的技術支持，充分保證培訓后出效果；
        3、培訓合格學員可享受免費推薦就業機會。 ☆合格學員免費頒發相關工程師等資格證書，提升您的職業資質。專注高端培訓13年，曙海提供的證書得到本行業的廣泛認可，學員的能力得到大家的認同，受到用人單位的廣泛贊譽。

課程大綱

全部授課內容均在計算機和實驗器材上實際操作。有周末班、連續班、晚班任選

Xilinx專業培訓課程

序號	課程名稱	培訓目標	最近開課時間	學期
芯片、集成電路設計系列培訓班
F1	Design for Performance	Design for Performance	2025年5月19日....	6天； 36學時
F2	Advance FPGA Implementation	Advance FPGA Implementation	2025年5月19日....	6天； 36學時
F3	Embedded System Design	Embedded System Design	2025年5月19日....	6天； 36學時
F4	AdvancedFeaturesandTechniquesofEmbedded Systems	AdvancedFeaturesandTechniquesofEmbedded Systems	2025年5月19日....	6天； 36學時
F5	Design LogiCORE PCI System	Design LogiCORE PCI System	2025年5月19日....	6天； 36學時
F6	Design LogiCORE PCIX System	Design LogiCORE PCIX System	2025年5月19日....	6天； 36學時
F7	Design LogiCORE PCI Express System	Design LogiCORE PCI Express System	2025年5月19日....	6天； 36學時
F8	DSP Implementation Techniques in Xilinx FPGAs	DSP Implementation Techniques in Xilinx FPGAs	2025年5月19日....	6天； 36學時
F9	Fundamental FPGA Design	Fundamental FPGA Design	2025年5月19日....	6天； 36學時
F10	DSP Design Flow	DSP Design Flow	2025年5月19日....	6天； 36學時
F11	Signal Integrity for High-Speed Memory and Processor I/O	Signal Integrity for High-Speed Memory and Processor I/O	2025年5月19日....	6天； 36學時
F12	Designing with Multi-Gigabit Serial I/O	Designing with Multi-Gigabit Serial I/O	2025年5月19日....	6天； 36學時
F13	Design with PlanAhead	Design with PlanAhead	2025年5月19日....	6天； 36學時
F14	ISE 設計入門	ISE 設計入門	2025年5月19日....	6天； 36學時
F15	Design with Virtex4	Design with Virtex4	2025年5月19日....	6天； 36學時
F16	Design with Virtex5 LX & LXT	Design with Virtex5 LX & LXT	2025年5月19日....	6天； 36學時
F17	Design for Low Cost	Design for Low Cost	2025年5月19日....	6天； 36學時
F18	Minimizing your design time with Chipscope pro debug	Minimizing your design time with Chipscope pro debug	2025年5月19日....	6天； 36學時
F19	Using System Generator for DSP Design	Using System Generator for DSP Design	2025年5月19日....	6天； 36學時
F20	Design with Xilinx Gigabit Ethernet MAC	Design with Xilinx Gigabit Ethernet MAC	2025年5月19日....	6天； 36學時
F21	Introduction to AccelDSP	Introduction to AccelDSP	2025年5月19日....	6天； 36學時
F22	Designing with Spartan-6 and Virtex-6 Families	Designing with Spartan-6 and Virtex-6 Families	2025年5月19日....	6天； 36學時