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 數(shù)字集成電路前端設(shè)計(jì)培訓(xùn)班
   課程目標(biāo)

  通過本課程的學(xué)習(xí),使學(xué)員在掌握數(shù)字集成電路設(shè)計(jì)的基本要領(lǐng),熟悉操作系統(tǒng)和硬件描述語言HDL,熟練使用邏輯綜合仿真工具和仿真工具,并學(xué)會(huì)IC設(shè)計(jì)公司的團(tuán)隊(duì)分工與合作,相當(dāng)于一年以上的數(shù)字電路設(shè)計(jì)水平和經(jīng)驗(yàn)。

  培養(yǎng)對(duì)象
  1.理工科背景,有志于數(shù)字集成電路設(shè)計(jì)工作的學(xué)生和轉(zhuǎn)行人員;
  2.需要充電,提升技術(shù)水平和熟悉設(shè)計(jì)流程的在職人員;
  3.集成電路設(shè)計(jì)企業(yè)的員工內(nèi)訓(xùn)。
   入學(xué)要求

        學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識(shí):
        ◆電路系統(tǒng)的基本概念。

   班級(jí)規(guī)模及環(huán)境
       為了保證培訓(xùn)效果,增加互動(dòng)環(huán)節(jié),我們堅(jiān)持小班授課,每期報(bào)名人數(shù)限3到5人,多余人員安排到下一期進(jìn)行。
   上課時(shí)間和地點(diǎn)
上課地點(diǎn):【上海】:同濟(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號(hào)線白銀路站) 【深圳分部】:電影大廈(地鐵一號(hào)線大劇院站)/深圳大學(xué)成教院 【北京分部】:北京中山學(xué)院/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領(lǐng)館區(qū)1號(hào)(中和大道) 【沈陽分部】:沈陽理工大學(xué)/六宅臻品 【鄭州分部】:鄭州大學(xué)/錦華大廈 【石家莊分部】:河北科技大學(xué)/瑞景大廈
最近開課時(shí)間(周末班/連續(xù)班/晚班)
數(shù)字集成電路前端:2025年12月15日..以服務(wù)質(zhì)量為生命....共贏、共創(chuàng)....資深工程師授課.....直播、現(xiàn)場(chǎng)培訓(xùn)皆可....用心服務(wù)..........
   學(xué)時(shí)
     ◆請(qǐng)咨詢客服

        ◆外地學(xué)員:代理安排食宿(需提前預(yù)定)
        ☆注重質(zhì)量
        ☆邊講邊練

        ☆合格學(xué)員免費(fèi)推薦工作

        ☆合格學(xué)員免費(fèi)頒發(fā)相關(guān)工程師等資格證書,提升您的職業(yè)資質(zhì)

        專注高端培訓(xùn)15年,曙海提供的證書得到本行業(yè)的廣泛認(rèn)可,學(xué)員的能力
        得到大家的認(rèn)同,受到用人單位的廣泛贊譽(yù)。

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   最新優(yōu)惠
       ◆團(tuán)體報(bào)名優(yōu)惠措施:請(qǐng)咨詢客服
   質(zhì)量保障

        1、培訓(xùn)過程中,如有部分內(nèi)容理解不透或消化不好,可免費(fèi)在以后培訓(xùn)班中重聽;
        2、培訓(xùn)結(jié)束后免費(fèi)提供半年的技術(shù)支持,充分保證培訓(xùn)后出效果;
        3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會(huì)。 ☆合格學(xué)員免費(fèi)頒發(fā)相關(guān)工程師等資格證書,提升您的職業(yè)資質(zhì)。專注高端培訓(xùn)13年,曙海提供的證書得到本行業(yè)的廣泛認(rèn)可,學(xué)員的能力得到大家的認(rèn)同,受到用人單位的廣泛贊譽(yù)。

        數(shù)字集成電路前端設(shè)計(jì)培訓(xùn)班

1. Unix/Linux操作系統(tǒng)使用
2. 文本編輯器VIM
3. 數(shù)字電路技術(shù)基礎(chǔ)
4. 半導(dǎo)體電路和工藝基礎(chǔ)
5. 數(shù)字邏輯設(shè)計(jì)
6. 數(shù)字集成電路設(shè)計(jì)流程
7. Verilog HDL硬件描述語言和電路設(shè)計(jì)技術(shù)與技巧
8. 電路驗(yàn)證技術(shù)以及Modelsim、VCS等驗(yàn)證工具的使用
9. ASIC和SOC設(shè)計(jì)導(dǎo)論
10. FPGA設(shè)計(jì)和驗(yàn)證初步
11. 邏輯綜合初步以及SYNOPSYS DC等綜合工具的使用
12. 可測(cè)性設(shè)計(jì)技術(shù)
13.ASIC技術(shù)

??? 重點(diǎn)講解數(shù)字電路設(shè)計(jì)的綜合技術(shù)的基本概念,綜合流程和工程經(jīng)驗(yàn),使學(xué)員掌握基于synopsys DC的綜合技巧。
內(nèi)容包括:?
綜合機(jī)理的分析;組合電路和時(shí)序電路實(shí)現(xiàn)規(guī)則和實(shí)例分析;基于tcl綜合的流程,優(yōu)化處理和調(diào)試技術(shù);綜合處理與后端流程的聯(lián)系;可綜合代碼技術(shù);需深入研究的內(nèi)容;LPC 接口模塊綜合實(shí)驗(yàn)
ASIC DFT技術(shù)
??? 介紹可測(cè)試設(shè)計(jì)技術(shù),使學(xué)員掌握基于Synopsys DFT 的可測(cè)性電路設(shè)計(jì)方法
內(nèi)容包括:
背景分析;組合電路和時(shí)序電路的測(cè)試;可測(cè)試設(shè)計(jì);需深入研究的內(nèi)容;DFT compile 使用(基于TCL的可測(cè)試性設(shè)計(jì)流程);LPC接口模塊DFT實(shí)驗(yàn)
ASIC 靜態(tài)時(shí)序分析技術(shù)
??? 介紹靜態(tài)時(shí)序分析技術(shù);使學(xué)員掌握基于Synopsysy PrimeTime的靜態(tài)時(shí)序分析技術(shù)。
內(nèi)容包括:
背景分析;電路時(shí)序分析的基礎(chǔ)內(nèi)容;工具的使用;靜態(tài)時(shí)序分析模式選擇;注意事項(xiàng)及需深入研究的內(nèi)容;LPC接口模塊實(shí)驗(yàn)
一致性驗(yàn)證(Formal)技術(shù)介紹
??? 介紹一致性驗(yàn)證技術(shù),使學(xué)員了解基于Synopsys Formality 的一致性驗(yàn)證方法
內(nèi)容包括:
背景分析;工具的使用介紹
14.形式驗(yàn)證技術(shù)。基于Formality的形式驗(yàn)證方法、基于匹配策略的形式驗(yàn)證技術(shù)、基于TCL的形式驗(yàn)證過程。

15、功耗控制技術(shù)。基于PrimePower的功耗分析技術(shù),基于Power Compiler的時(shí)鐘門控技術(shù)、基于數(shù)字單元庫的功耗分析方法、基于TCL的功耗分析等多種功耗分析方法和時(shí)鐘門控技術(shù)的實(shí)現(xiàn)。

16、LAYOUT設(shè)計(jì)流程。基于ASTRO的芯片Layout技術(shù)及基于SPEF反標(biāo)提取的PostLayout相關(guān)數(shù)字流程,包含在PostLayout中的網(wǎng)表提取、參數(shù)提取、形式驗(yàn)證、靜態(tài)實(shí)現(xiàn)驗(yàn)證、門級(jí)功能仿真、功耗分析,以及Layout驗(yàn)證(DRC、LVS)等技巧。

17、UWB項(xiàng)目開發(fā)過程中的各種電路優(yōu)化手段

18、UWB項(xiàng)目介紹。立項(xiàng)分析、實(shí)現(xiàn)方案的規(guī)劃。

19、VLSI系統(tǒng)的設(shè)計(jì)方法學(xué)。時(shí)序分析法、基于Snopsys EDA Tools Chain實(shí)現(xiàn)的完整ASIC設(shè)計(jì)流程、數(shù)字設(shè)計(jì)庫的介紹,分析、創(chuàng)建,及使用。

20、編碼及仿真技巧。編碼規(guī)范、RTL驗(yàn)證仿真技術(shù)、門級(jí)仿真技術(shù)。

21、ASIC設(shè)計(jì)流程的高級(jí)話題。例如跨時(shí)鐘域信號(hào)的處理,同步撫慰電路設(shè)計(jì)及相關(guān)流程處理等設(shè)計(jì)技巧。
22. 項(xiàng)目設(shè)計(jì)實(shí)訓(xùn):
大型實(shí)訓(xùn)項(xiàng)目一.Sigma-Delta小數(shù)分頻器設(shè)計(jì)、驗(yàn)證與綜合
大型實(shí)訓(xùn)項(xiàng)目二.DVI編碼器/解碼器設(shè)計(jì)、驗(yàn)證與綜合

 
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.(2014年7月11)...........................................................................................................
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