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嵌入式OS-Linux

Linux應(yīng)用開發(fā)班
嵌入式Linux系統(tǒng)開發(fā)班

嵌入式Linux驅(qū)動開發(fā)班
Linux網(wǎng)絡(luò)工程及系統(tǒng)管理
Linux驅(qū)動、系統(tǒng)、應(yīng)用全能班

嵌入式CPU--ARM

ARM開發(fā)培訓(xùn)班

CortexM3+uC/OS培訓(xùn)班

嵌入式OS--WinCE

WinCE應(yīng)用開發(fā)培訓(xùn)班

WinCE系統(tǒng)定制與驅(qū)動班

單片機培訓(xùn)

單片機系統(tǒng)開發(fā)初級和中級班

單片機系統(tǒng)開發(fā)高級班

嵌入式硬件設(shè)計

高速嵌入式系統(tǒng)硬件設(shè)計班

Allegro Cadence PCB設(shè)計初級和中級班

Allegro Cadence PCB設(shè)計高級班

Power Pcb(PADS)設(shè)計培訓(xùn)班

Protel培訓(xùn)班

高效開關(guān)電源設(shè)計與提高班

電路設(shè)計培訓(xùn)

EMC設(shè)計高級培訓(xùn)班

PCB Layout培訓(xùn)-線路板設(shè)計全能班

Altium Designer Layout高速硬件設(shè)計

Mentor EE 高速電路板設(shè)計與仿真

Mentor WG 高速電路板設(shè)計與仿真

模擬電路前端設(shè)計培訓(xùn)班

電路設(shè)計全能班

電子電路設(shè)計高級培訓(xùn)班

芯片設(shè)計培訓(xùn)班

集成電路（IC）版圖設(shè)計培訓(xùn)班

RF射頻電路設(shè)計培訓(xùn)班

數(shù)字集成電路前端設(shè)計培訓(xùn)班

數(shù)字、模擬電路設(shè)計培訓(xùn)班

SOC設(shè)計培訓(xùn)班

嵌入式OS--VxWorks

VxWorks應(yīng)用開發(fā)培訓(xùn)班

VxWorks BSP開發(fā)高級班

PowerPC嵌入式系統(tǒng)/編譯器優(yōu)化

PowerPC(PPC)系統(tǒng)開發(fā)培訓(xùn)班

飛思卡爾MPC系統(tǒng)開發(fā)培訓(xùn)班

編譯器原理及優(yōu)化技術(shù)專題班


PLC編程/變頻器/數(shù)控/人機界面

PLC編程系列培訓(xùn)課程表
變頻器系列培訓(xùn)課程表

人機界面、數(shù)控系列培訓(xùn)課程表

開發(fā)語言/數(shù)據(jù)庫/軟硬件測試

Java/.NET/C#/SQL全能培訓(xùn)班

Oracle數(shù)據(jù)庫培訓(xùn)

SQL Server數(shù)據(jù)庫培訓(xùn)

軟件測試培訓(xùn)

硬件測試培訓(xùn)

系統(tǒng)構(gòu)架師培訓(xùn)

3G手機軟件測試、硬件測試

芯片設(shè)計/大規(guī)模集成電路VLSI

芯片、集成電路設(shè)計系列一課程表

芯片、集成電路設(shè)計系列二課程表

云計算、物聯(lián)網(wǎng)

云計算、云安全培訓(xùn)班

物聯(lián)網(wǎng)產(chǎn)業(yè)、核心技術(shù)培訓(xùn)班

開源操作系統(tǒng)Tigy OS開發(fā)

小型機系統(tǒng)管理

IBM AIX 6 Basics培訓(xùn)班

IBM AIX 6 System II培訓(xùn)班

Solaris 操作系統(tǒng)網(wǎng)絡(luò)管理

HP-Unix系統(tǒng)及網(wǎng)絡(luò)管理

IBM 大型機操作系統(tǒng)培訓(xùn)班

SolidEdge ST&ST2 實戰(zhàn)

網(wǎng)絡(luò)安全管理實戰(zhàn)培訓(xùn)

其他類

長期班

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企業(yè)招聘與人才推薦(免費)

合作企業(yè)最新人才需求公告
◆招人、應(yīng)聘、人才合作，請把需求發(fā)到officeoffice@126.com或訪問曙海旗下網(wǎng)站--- 電子人才網(wǎng)： www.morning-sea.com.cn

合作伙伴與授權(quán)機構(gòu)

現(xiàn)代化的多媒體教室

曙海集團(tuán)招聘啟示

最新招聘信息（2011年7月23日）

曙海動態(tài)

第21期MTK培訓(xùn)班完滿結(jié)業(yè)
[2010-4-1]

2009年“寒假培訓(xùn)系列課程”
開始招生[2008-12-31]

曙海嵌入式學(xué)院隆重推出“寒
假培訓(xùn)系列課程”[2007-12-16]

慶祝曙海創(chuàng)立5周年，部分課
程9折回饋學(xué)員[2006-03-12]

為普及嵌入式課程，學(xué)生
報名享受優(yōu)惠[2005-08-03]

曙海教育嵌入式培訓(xùn)課程全面
升級,啟用2.0版[2004-06-14]

曙海教育成為Altera公司
全球合作培訓(xùn)機構(gòu)[2002-10-07]

020321屆Linux驅(qū)動開發(fā)班
學(xué)生圓滿畢業(yè)[2002-04-25]

上海計算機技術(shù)協(xié)會頒發(fā)給曙海
高新技術(shù)科技證書[2001-05-19]

郵件列表

　　　DSP Design Flow

班級規(guī)模及環(huán)境

為了保證培訓(xùn)效果，增加互動環(huán)節(jié)，我們堅持小班授課，每期報名人數(shù)限5人，多余人員安排到下一期進(jìn)行。

上課時間和地點

上課地點：【上海】：同濟(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院【北京分部】：北京中山學(xué)院/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領(lǐng)館區(qū)1號（中和大道）
最近開課時間(周末班/連續(xù)班/晚班）：DSP Design Flow：2025年7月14日..用心服務(wù)..........

學(xué)時

　    ◆課時：一個月

        ◆外地學(xué)員：代理安排食宿（需提前預(yù)定）
        ☆合格學(xué)員免費頒發(fā)相關(guān)資格證書，提升您的職業(yè)資質(zhì)
        作為最早專注于嵌入式培訓(xùn)的專業(yè)機構(gòu)，曙海嵌入式學(xué)院提供的證書得到本行業(yè)的廣泛認(rèn)
        可，學(xué)員的能力得到大家的認(rèn)同。
        ☆合格學(xué)員免費推薦工作
        ★實驗設(shè)備請點擊這兒查看★

最新優(yōu)惠

◆團(tuán)體報名優(yōu)惠措施：請咨詢客服

質(zhì)量保障

        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓(xùn)班中重聽；
        2、培訓(xùn)結(jié)束后,培訓(xùn)老師留給學(xué)員手機和Email,免費提供半年的技術(shù)支持，充分保證培訓(xùn)后出效果；
        3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。 ☆合格學(xué)員免費頒發(fā)相關(guān)工程師等資格證書，提升您的職業(yè)資質(zhì)。專注高端培訓(xùn)13年，曙海提供的證書得到本行業(yè)的廣泛認(rèn)可，學(xué)員的能力得到大家的認(rèn)同，受到用人單位的廣泛贊譽。

　　DSP Design Flow

課程介紹

DSP 設(shè)計流程課程提供了您所需的高級工具和專門技術(shù)，以開發(fā)更先進(jìn)的低成本DSP 設(shè)計。這個中級課程講解了DSP 功能的實現(xiàn)，側(cè)重于講授如何使用SystemGenerator for DSP，以及HDL 設(shè)計流程，CORE Generator™軟件，設(shè)計實現(xiàn)工具，以及基于Modelsim 的HDL 協(xié)同驗證與基于Simulink 與JTAG 的軟硬件算法協(xié)同驗證，您將親自體驗采用從設(shè)計算法概念到硬件驗證，利用Xilinx FPGA 的功能來實現(xiàn)設(shè)計的整個過程。

必備條件

        ?? 具備 VHDL 或Verilog 方面的基礎(chǔ)知識
        ?? 至少具備 6 個月的使用Xilinx 工具和FPGA 的設(shè)計經(jīng)驗
        ?? MATLAB/Simulink 和Xilinx FPGA 的基礎(chǔ)知識
        ?? 數(shù)字信號處理理論在如 FIR 濾波器，混頻器以及FFT 變換算法等基本知識

課程概要

        ?? 如何在設(shè)計過程中對算法的時間代價與硬件資源代價進(jìn)行折衷考慮
        ?? 了解在 Simulink 環(huán)境中，算法如何影響FPGA 的硬件資源代價
        ?? 了解三種流程的優(yōu)、缺點(HDL, CORE Generator, System Generator)
        ?? 用 System Generator 從始至終實現(xiàn)一個設(shè)計
        ?? HDL 協(xié)同驗證與硬件協(xié)同驗證

實驗介紹

        實驗1．用VHDL 創(chuàng)建12 x 8 MAC
        實驗2．用Xilinx CORE Generator 系統(tǒng)創(chuàng)建 12 x 8 MAC
        實驗3．用Xilinx System Generator 創(chuàng)建12 x 8 MAC
        實驗4．設(shè)計FIR 濾波器
        實驗5．采用HDL 協(xié)同仿真及硬件協(xié)同仿真進(jìn)行MAC FIR 濾波器驗證
        實驗6．搭建DSP 控制系統(tǒng)
        實驗7．設(shè)計MAC FIR
        實驗8．采用PicoBlaze™微控制器進(jìn)行設(shè)計
        實驗9．創(chuàng)建參數(shù)化設(shè)計